STA309B datasheet(4/66 Pages) STMICROELECTRONICS

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Contents

STA309B

4/66

Doc ID 022570 Rev 2

7.2.44

Tone control bypass (0x2B) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 44

7.2.45

Tone control (0x2C) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

7.2.46

Channel limiter select channels 1,2,3,4 (0x2D) . . . . . . . . . . . . . . . . . . . 45

7.2.47

Channel limiter select channels 5,6,7,8 (0x2E) . . . . . . . . . . . . . . . . . . . 45

7.2.48

Limiter 1 attack/release rate (0x2F) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

7.2.49

Limiter 1 attack/release threshold (0x30) . . . . . . . . . . . . . . . . . . . . . . . . 46

7.2.50

Limiter 2 attack/release rate (0x31) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

7.2.51

Limiter 2 attack/release threshold (0x32) . . . . . . . . . . . . . . . . . . . . . . . . 46

7.2.52

Bit description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

7.2.53

Channel 1 and 2 output timing (0x33) . . . . . . . . . . . . . . . . . . . . . . . . . . 50

7.2.54

Channel 3 and 4 output timing (0x34) . . . . . . . . . . . . . . . . . . . . . . . . . . 50

7.2.55

Channel 5 and 6 output timing (0x35) . . . . . . . . . . . . . . . . . . . . . . . . . . 50

7.2.56

Channel 7 and 8 output timing (0x36) . . . . . . . . . . . . . . . . . . . . . . . . . . 51

7.2.57

Channel I2S output mapping channels 1 and 2 (0x37) . . . . . . . . . . . . . 51

7.2.58

Channel I2S output mapping channels 3 and 4 (0x38) . . . . . . . . . . . . . 51

7.2.59

Channel I2S output mapping channels 5 and 6 (0x39) . . . . . . . . . . . . . 51

7.2.60

Channel I2S output mapping channels 7 and 8 (0x3A) . . . . . . . . . . . . . 52

7.2.61

Coefficient address register 1 (0x3B) . . . . . . . . . . . . . . . . . . . . . . . . . . 52

7.2.62

Coefficient address register 2 (0x3C) . . . . . . . . . . . . . . . . . . . . . . . . . . 52

7.2.63

Coefficient b1 data register, bits 23:16 (0x3D) . . . . . . . . . . . . . . . . . . . . 52

7.2.64

Coefficient b1 data register, bits 15:8 (0x3E) . . . . . . . . . . . . . . . . . . . . . 53

7.2.65

Coefficient b1 data register, bits 7:0 (0x3F) . . . . . . . . . . . . . . . . . . . . . . 53

7.2.66

Coefficient b2 data register, bits 23:16 (0x40) . . . . . . . . . . . . . . . . . . . . 53

7.2.67

Coefficient b2 data register, bits 15:8 (0x41) . . . . . . . . . . . . . . . . . . . . . 53

7.2.68

Coefficient b2 data register, bits 7:0 (0x42) . . . . . . . . . . . . . . . . . . . . . . 53

7.2.69

Coefficient a1 data register, bits 23:16 (0x43) . . . . . . . . . . . . . . . . . . . . 53

7.2.70

Coefficient a1 data register, bits 15:8 (0x44) . . . . . . . . . . . . . . . . . . . . . 53

7.2.71

Coefficient a1 data register, bits 7:0 (0x45) . . . . . . . . . . . . . . . . . . . . . . 54

7.2.72

Coefficient a2 data register, bits 23:16 (0x46) . . . . . . . . . . . . . . . . . . . . 54

7.2.73

Coefficient a2 data register, bits 15:8 (0x47) . . . . . . . . . . . . . . . . . . . . . 54

7.2.74

Coefficient a2 data register, bits 7:0 (0x48) . . . . . . . . . . . . . . . . . . . . . . 54

7.2.75

Coefficient b0 data register, bits 23:16 (0x49) . . . . . . . . . . . . . . . . . . . . 54

7.2.76

Coefficient b0 data register, bits 15:8 (0x4A) . . . . . . . . . . . . . . . . . . . . . 54

7.2.77

Coefficient b0 data register, bits 7:0 (0x4B) . . . . . . . . . . . . . . . . . . . . . . 54

7.2.78

Coefficient write control register (0x4C) . . . . . . . . . . . . . . . . . . . . . . . . . 55

7.3

Reading a coefficient from RAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 55

7.4

Reading a set of coefficients from RAM . . . . . . . . . . . . . . . . . . . . . . . . . . 55

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